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MC100EP195集成電路（IC）的延遲線規(guī)格書(shū)PDF中文資料

MC100EP195
廠商型號(hào)

MC100EP195
參數(shù)屬性

MC100EP195 封裝/外殼為32-LQFP；包裝為卷帶（TR）；類別為集成電路（IC）的延遲線；產(chǎn)品描述：IC DELAY LN 1024TAP PROG 32LQFP
功能描述

可編程
3.3V ECL Programmable Delay Chip
IC DELAY LN 1024TAP PROG 32LQFP
封裝外殼

32-LQFP
文件大小

127.14 Kbytes
頁(yè)面數(shù)量

20 頁(yè)
生產(chǎn)廠商 ON Semiconductor
企業(yè)簡(jiǎn)稱

ONSEMI【安森美半導(dǎo)體】

中文名稱

安森美半導(dǎo)體公司官網(wǎng)
原廠標(biāo)識(shí)
數(shù)據(jù)手冊(cè)

原廠下載下載地址一下載地址二到原廠下載
更新時(shí)間

2025-2-6 22:30:00

MC100EP195規(guī)格書(shū)詳情

MC100EP195屬于集成電路（IC）的延遲線。由安森美半導(dǎo)體公司制造生產(chǎn)的MC100EP195延遲線時(shí)鐘延遲線產(chǎn)品族中的產(chǎn)品屬于數(shù)字器件，用于在數(shù)字信號(hào)中引入時(shí)間延遲，以便將提交給器件輸入的信號(hào)躍遷，經(jīng)過(guò)某一已知時(shí)間之后在輸出端復(fù)現(xiàn)。它們常用于高速數(shù)字系統(tǒng)，以校正或補(bǔ)償不同信號(hào)路徑之間的信號(hào)傳播時(shí)間的偏差。這些器件可用于產(chǎn)生固定、可選或可變持續(xù)時(shí)間的延遲。

The MC10/100EP195 is a Programmable Delay Chip (PDC) designed primarily for clock deskewing and timing adjustment. It provides variable delay of a differential NECL/PECL input transition.

The 100 Series contains temperature compensation.

? Maximum Input Clock Frequency >1.2 GHz Typical

? Programmable Range: 0 ns to 10 ns

? Delay Range: 2.2 ns to 12.2 ns

? 10 ps Increments

? PECL Mode Operating Range: VCC = 3.0 V to 3.6 V with VEE = 0 V

? NECL Mode Operating Range: VCC = 0 V with VEE = ?3.0 V to ?3.6 V

? Open Input Default State

? Safety Clamp on Inputs

? A Logic High on the EN Pin Will Force Q to Logic Low

? D[10:0] Can Accept Either ECL, LVCMOS, or LVTTL Inputs

? VBB Output Reference Voltage

? Pb?Free Packages are Available

產(chǎn)品屬性

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  • 產(chǎn)品編號(hào)：

    MC100EP195BFAR2G

  • 制造商：

    onsemi

  • 類別：

    集成電路（IC） > 延遲線

  • 系列：

    100EP

  • 包裝：

    卷帶（TR）

  • 功能：

    可編程

  • 延遲到第 1 抽頭：

    2.5ns

  • 可用總延遲：

    2.5ns ~ 13ns

  • 電壓 - 供電：

    3V ~ 3.6V

  • 工作溫度：

    -40°C ~ 85°C

  • 安裝類型：

    表面貼裝型

  • 封裝/外殼：

    32-LQFP

  • 供應(yīng)商器件封裝：

    32-LQFP（7x7）

  • 描述：

    IC DELAY LN 1024TAP PROG 32LQFP

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