MC88916DW集成電路（IC）的應用特定時鐘/定時規(guī)格書PDF中文資料
| 廠商型號 |
MC88916DW |
| 參數(shù)屬性 | MC88916DW 封裝/外殼為20-SOIC（0.295"，7.50mm 寬）；包裝為托盤；類別為集成電路（IC）的應用特定時鐘/定時；產(chǎn)品描述：IC CLK BUF CISC 70MHZ 1CIRC |
| 功能描述 | LOW SKEW CMOS PLL CLOCK DRIVER WITH PROCESSOR RESET |
| 封裝外殼 | 20-SOIC（0.295"，7.50mm 寬） |
| 文件大小 |
114.04 Kbytes |
| 頁面數(shù)量 |
9 頁 |
| 生產(chǎn)廠商 | Motorola, Inc |
| 企業(yè)簡稱 |
Motorola【摩托羅拉】 |
| 中文名稱 | 加爾文制造公司官網(wǎng) |
| 原廠標識 |  |
| 數(shù)據(jù)手冊 | |
| 更新時間 | 2025-2-24 17:00:00 |
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MC88916DW規(guī)格書詳情
The MC88916 Clock Driver utilizes phase–locked loop technology to lock its low skew outputs’ frequency and phase onto an input reference clock. It is designed to provide clock distribution for CISC microprocessor or single processor RISC systems.
? Provides Performance Required to Drive 68030 Microprocessor Family as well as the 33 and 40MHz 68040 Microprocessors
? Three Outputs (Q0–Q2) With Output–Output Skew <500ps and Six Outputs Total (Q0–Q2, Q3, 2X_Q,) With <1ns Skew Each Being Phase and Frequency Locked to the SYNC Input
? The Phase Variation From Part–to–Part Between SYNC and the ‘Q’ Outputs Is Less Than 600ps (Derived From the TPD Specification, Which Defines the Part–to–Part Skew)
? SYNC Input Frequency Range From 5MHZ to 2X_Q FMax/4
? Additional Outputs Available at 2X and ÷2 the System ‘Q’ Frequency. Also a Q (180° Phase Shift) Output Available.
? All Outputs Have ±36mA Drive (Equal High and Low) CMOS Levels. Can Drive Either CMOS or TTL Inputs. All Inputs Are TTL–Level Compatible
? Test Mode Pin (PLL_EN) Provided for Low Frequency Testing
產(chǎn)品屬性
- 產(chǎn)品編號：
MC88916DW70
- 制造商：
NXP USA Inc.
- 類別：
集成電路（IC） > 應用特定時鐘/定時
- 包裝：
托盤
- PLL：
是
- 主要用途：
CISC/RISC 微處理器
- 輸入：
TTL
- 輸出：
CMOS，TTL
- 比率 - 輸入：
1：6
- 差分 - 輸入：
無/無
- 頻率 - 最大值：
70MHz
- 電壓 - 供電：
4.5V ~ 5.5V
- 工作溫度：
-40°C ~ 85°C
- 安裝類型：
表面貼裝型
- 封裝/外殼：
20-SOIC（0.295"，7.50mm 寬）
- 供應商器件封裝：
20-SOIC
- 描述：
IC CLK BUF CISC 70MHZ 1CIRC
| 供應商 | 型號 | 品牌 | 批號 | 封裝 | 庫存 | 備注 | 價格 |
|---|---|---|---|---|---|---|---|
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