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SY100E151JC集成電路（IC）的觸發(fā)器規(guī)格書PDF中文資料
| 廠商型號(hào) |
SY100E151JC |
| 參數(shù)屬性 | SY100E151JC 封裝/外殼為28-LCC（J 形引線）；包裝為管件；類別為集成電路（IC）的觸發(fā)器；產(chǎn)品描述：IC FF D-TYPE SNGL 6BIT 28PLCC |
| 功能描述 | 6-BIT D REGISTER |
| 封裝外殼 | 28-LCC（J 形引線） |
| 文件大小 |
66.31 Kbytes |
| 頁(yè)面數(shù)量 |
4 頁(yè) |
| 生產(chǎn)廠商 | Micrel Semiconductor |
| 企業(yè)簡(jiǎn)稱 |
Micrel【麥瑞半導(dǎo)體】 |
| 中文名稱 | 麥瑞半導(dǎo)體官網(wǎng) |
| 原廠標(biāo)識(shí) |  |
| 數(shù)據(jù)手冊(cè) | |
| 更新時(shí)間 | 2025-5-25 23:01:00 |
| 人工找貨 | SY100E151JC價(jià)格和庫(kù)存，歡迎聯(lián)系客服免費(fèi)人工找貨 |
SY100E151JC規(guī)格書詳情
DESCRIPTION
The SY10/100E151 offer 6 edge-triggered, high-speed, master-slave D-type flip-flops with differential outputs, designed for use in new, high-performance ECL systems. The two external clock signals (CLK1, CLK2) are gated through a logical OR operation before use as clocking control for the flip-flops. Data is clocked into the flip-flops on the rising edge of either CLK1 or CLK2 (or both). When both CLK1 and CLK2 are at a logic LOW, data enters the master and is transferred to the slave when either CLK1 or CLK2 (or both) go HIGH.
The MR (Master Reset) signal operates asynchronously to make all Q outputs go to a logic LOW.
FEATURES
■ 1100MHz toggle frequency
■ Extended 100E VEE range of –4.2V to –5.46V
■ Differential outputs
■ Asynchronous Master Reset
■ Dual clocks
■ Fully compatible with industry standard 10KH, 100K ECL levels
■ Internal 75K? input pulldown resistors
■ Fully compatible with Motorola MC10E/100E151
■ Available in 28-pin PLCC package
產(chǎn)品屬性
- 產(chǎn)品編號(hào)：
SY100E151JC
- 制造商：
Microchip Technology
- 類別：
集成電路（IC） > 觸發(fā)器
- 系列：
100E
- 包裝：
管件
- 功能：
主復(fù)位
- 類型：
D 型
- 輸出類型：
補(bǔ)充型
- 觸發(fā)器類型：
正邊沿
- 電壓 - 供電：
-4.2V ~ -5.46V
- 工作溫度：
0°C ~ 70°C（TA）
- 安裝類型：
表面貼裝型
- 供應(yīng)商器件封裝：
28-PLCC（11.48x11.48）
- 封裝/外殼：
28-LCC（J 形引線）
- 描述：
IC FF D-TYPE SNGL 6BIT 28PLCC
| 供應(yīng)商 | 型號(hào) | 品牌 | 批號(hào) | 封裝 | 庫(kù)存 | 備注 | 價(jià)格 |
|---|---|---|---|---|---|---|---|
SYNERGY |
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